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Logique Arithmetique Et Techniques Synchrones. Arithmetique Binaire Et Decimale, Conception Synchrone Des Asics Et Des Fpgas
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- Nombre de pages196
- PrésentationBroché
- Poids0.355 kg
- Dimensions16,0 cm × 24,0 cm × 1,2 cm
- ISBN2-225-85227-8
- EAN9782225852275
- Date de parution01/05/1996
- Collectionenseignement de l'électronique
- ÉditeurElsevier Masson
Résumé
Ce cours présente les algorithmes fondamentaux de l'arithmétique et les méthodes les plus récentes de conception synchrone de systèmes logiques. Les algorithmes d'arithmétique binaire et décimale et les schémas associés sont présentés en première partie de l'ouvrage. L'auteur montre qu'ils constituent une base précieuse pour leur modélisation dans le langage VHDL.
La seconde partie décrit les techniques de conception synchrone d'un système logique, encore peu connues, mais indispensables pour la conception d'un ASIC ou d'un FPGA.
L'ensemble constitue un ouvrage de référence pour les étudiants en électronique, ainsi que les ingénieurs et les techniciens.
Ce cours présente les algorithmes fondamentaux de l'arithmétique et les méthodes les plus récentes de conception synchrone de systèmes logiques. Les algorithmes d'arithmétique binaire et décimale et les schémas associés sont présentés en première partie de l'ouvrage. L'auteur montre qu'ils constituent une base précieuse pour leur modélisation dans le langage VHDL.
La seconde partie décrit les techniques de conception synchrone d'un système logique, encore peu connues, mais indispensables pour la conception d'un ASIC ou d'un FPGA.
L'ensemble constitue un ouvrage de référence pour les étudiants en électronique, ainsi que les ingénieurs et les techniciens.
A propos de Michel Aumiaux